Intellectual property core for serial communication protocols in FPGA
Throughout this project, a methodology based on Intellectual Property (IP) Cores is implemented for two serial communication protocols, one asynchronous (UART) and one synchronous (SPI), on an FPGA board. With this in mind, a high-level software model is proposed as a reference to a low-level RTL al...
- Autores:
-
Acosta David, Favio Andrés
- Tipo de recurso:
- Trabajo de grado de pregrado
- Fecha de publicación:
- 2020
- Institución:
- Universidad de los Andes
- Repositorio:
- Séneca: repositorio Uniandes
- Idioma:
- eng
- OAI Identifier:
- oai:repositorio.uniandes.edu.co:1992/51530
- Acceso en línea:
- http://hdl.handle.net/1992/51530
- Palabra clave:
- Microcontroladores
Matrices lógicas programables por el usuario
Sistemas de transmisión de datos
Ingeniería
- Rights
- openAccess
- License
- https://repositorio.uniandes.edu.co/static/pdf/aceptacion_uso_es.pdf