Implementación de filtros digitales sobre FPGA usando Vivado HLS

Este trabajo de grado tiene como objetivo la implementación de filtros digitales sobre un sistema de desarrollo ZedBoard, usando el entorno de desarrollo Vivado High Level Synthesis (HLS). El aporte principal de este trabajo es la realización de un tutorial sobre la implementación de algoritmos de p...

Full description

Autores:
Puerta Orrego, Juan Pablo
Tipo de recurso:
Trabajo de grado de pregrado
Fecha de publicación:
2017
Institución:
Instituto Tecnológico Metropolitano
Repositorio:
Repositorio ITM
Idioma:
spa
OAI Identifier:
oai:repositorio.itm.edu.co:20.500.12622/1565
Acceso en línea:
http://hdl.handle.net/20.500.12622/1565
Palabra clave:
Matriz de puertas programables
Electric filters
Digital electronics
Signal processing
Modulation (electronics)
Filtros eléctricos digitales
Electrónica digital
Procesamiento de señales - Técnicas digitales
Modulación (Electrónica)
Rights
License
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description Este trabajo de grado tiene como objetivo la implementación de filtros digitales sobre un sistema de desarrollo ZedBoard, usando el entorno de desarrollo Vivado High Level Synthesis (HLS). El aporte principal de este trabajo es la realización de un tutorial sobre la implementación de algoritmos de procesamiento digital de señales sobre FPGA. Específicamente se realizó la implementación de filtros FIR para señales unidimensionales. Las implementaciones se realizaron sobre señales de frecuencia modulada lineal, también conocida como Chirp, que es una onda sinusoidal simple que aumenta su frecuencia con el tiempo, permitiendo hacer un análisis fácil del funcionamiento del filtro implementado debido a que podemos ver el resultado de la aplicación del filtro también en el dominio del tiempo.
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Las implementaciones se realizaron sobre señales de frecuencia modulada lineal, también conocida como Chirp, que es una onda sinusoidal simple que aumenta su frecuencia con el tiempo, permitiendo hacer un análisis fácil del funcionamiento del filtro implementado debido a que podemos ver el resultado de la aplicación del filtro también en el dominio del tiempo.Ingeniero ElectrónicopregradoRecurso electrónicoapplication/pdfspaInstituto Tecnológico MetropolitanoFacultad de IngenieríasIngeniería ElectrónicaInstituto Tecnológico Metropolitanohttp://creativecommons.org/licenses/by-nc-nd/4.0/Acceso abiertoAttribution-NonCommercial-NoDerivatives 4.0 Internationalhttp://purl.org/coar/access_right/c_abf2Matriz de puertas programablesElectric filtersDigital electronicsSignal processingModulation (electronics)Filtros eléctricos digitalesElectrónica digitalProcesamiento de señales - Técnicas digitalesModulación (Electrónica)Implementación de filtros digitales sobre FPGA usando Vivado HLSTesis/Trabajo de grado - Monografía - Pregradohttp://purl.org/coar/resource_type/c_7a1finfo:eu-repo/semantics/bachelorThesisORIGINALRep_Itm_pre_Puerta.pdfRep_Itm_pre_Puerta.pdfapplication/pdf3373136https://repositorio.itm.edu.co/bitstream/20.500.12622/1565/1/Rep_Itm_pre_Puerta.pdf8366cac0c43ef02cce63f6a8b8d47f88MD51LICENSElicense.txtlicense.txttext/plain; charset=utf-81835https://repositorio.itm.edu.co/bitstream/20.500.12622/1565/2/license.txt804769f546724af03b8054dca7e9fe3fMD52THUMBNAILRep_Itm_pre_Puerta.pdf.jpgRep_Itm_pre_Puerta.pdf.jpgGenerated Thumbnailimage/jpeg2942https://repositorio.itm.edu.co/bitstream/20.500.12622/1565/3/Rep_Itm_pre_Puerta.pdf.jpg7f55f4e6534562e7e8da3f79b81afb6aMD5320.500.12622/1565oai:repositorio.itm.edu.co:20.500.12622/15652021-03-23 09:50:12.009Repositorio Instituto Tecnológico Metropolitano ITMrepositorio@itm.edu.coTk9URTogUExBQ0UgWU9VUiBPV04gTElDRU5TRSBIRVJFCgpUaGlzIHNhbXBsZSBsaWNlbnNlIGlzIHByb3ZpZGVkIGZvciBpbmZvcm1hdGlvbmFsIHB1cnBvc2VzIG9ubHkuCgoKSWYgdGhlIHN1Ym1pc3Npb24gY29udGFpbnMgbWF0ZXJpYWwgZm9yIHdoaWNoIHlvdSBkbyBub3QgaG9sZCBjb3B5cmlnaHQsCnlvdSByZXByZXNlbnQgdGhhdCB5b3UgaGF2ZSBvYnRhaW5lZCB0aGUgdW5yZXN0cmljdGVkIHBlcm1pc3Npb24gb2YgdGhlCmNvcHlyaWdodCBvd25lciB0byBncmFudCBEU1UgdGhlIHJpZ2h0cyByZXF1aXJlZCBieSB0aGlzIGxpY2Vuc2UsIGFuZCB0aGF0CnN1Y2ggdGhpcmQtcGFydHkgb3duZWQgbWF0ZXJpYWwgaXMgY2xlYXJseSBpZGVudGlmaWVkIGFuZCBhY2tub3dsZWRnZWQKd2l0aGluIHRoZSB0ZXh0IG9yIGNvbnRlbnQgb2YgdGhlIHN1Ym1pc3Npb24uCgpJRiBUSEUgU1VCTUlTU0lPTiBJUyBCQVNFRCBVUE9OIFdPUksgVEhBVCBIQVMgQkVFTiBTUE9OU09SRUQgT1IgU1VQUE9SVEVECkJZIEFOIEFHRU5DWSBPUiBPUkdBTklaQVRJT04gT1RIRVIgVEhBTiBEU1UsIFlPVSBSRVBSRVNFTlQgVEhBVCBZT1UgSEFWRQpGVUxGSUxMRUQgQU5ZIFJJR0hUIE9GIFJFVklFVyBPUiBPVEhFUiBPQkxJR0FUSU9OUyBSRVFVSVJFRCBCWSBTVUNICkNPTlRSQUNUIE9SIEFHUkVFTUVOVC4KCkRTVSB3aWxsIGNsZWFybHkgaWRlbnRpZnkgeW91ciBuYW1lKHMpIGFzIHRoZSBhdXRob3Iocykgb3Igb3duZXIocykgb2YgdGhlCnN1Ym1pc3Npb24sIGFuZCB3aWxsIG5vdCBtYWtlIGFueSBhbHRlcmF0aW9uLCBvdGhlciB0aGFuIGFzIGFsbG93ZWQgYnkgdGhpcwpZb3UgcmVwcmVzZW50IHRoYXQgdGhlIHN1Ym1pc3Npb24gaXMgeW91ciBvcmlnaW5hbCB3b3JrLCBhbmQgdGhhdCB5b3UgaGF2ZQp0aGUgcmlnaHQgdG8gZ3JhbnQgdGhlIHJpZ2h0cyBjb250YWluZWQgaW4gdGhpcyBsaWNlbnNlLiBZb3UgYWxzbyByZXByZXNlbnQKdGhhdCB5b3VyIHN1Ym1pc3Npb24gZG9lcyBub3QsIHRvIHRoZSBiZXN0IG9mIHlvdXIga25vd2xlZGdlLCBpbmZyaW5nZSB1cG9uCmFueW9uZSdzIGNvcHlyaWdodC4KCklmIHRoZSBzdWJtaXNzaW9uIGNvbnRhaW5zIG1hdGVyaWFsIGZvciB3aGljaCB5b3UgZG8gbm90IGhvbGQgY29weXJpZ2h0LAp5b3UgcmVwcmVzZW50IHRoYXQgeW91IGhhdmUgb2J0YWluZWQgdGhlIHVucmVzdHJpY3RlZCBwZXJtaXNzaW9uIG9mIHRoZQpjb3B5cmlnaHQgb3duZXIgdG8gZ3JhbnQgRFNVIHRoZSByaWdodHMgcmVxdWlyZWQgYnkgdGhpcyBsaWNlbnNlLCBhbmQgdGhhdApzdWNoIHRoaXJkLXBhcnR5IG93bmVkIG1hdGVyaWFsIGlzIGNsZWFybHkgaWRlbnRpZmllZCBhbmQgYWNrbm93bGVkZ2VkCndpdGhpbiB0aGUgdGV4dCBvciBjb250ZW50IG9mIHRoZSBzdWJtaXNzaW9uLgoKSUYgVEhFIFNVQk1JU1NJT04gSVMgQkFTRUQgVVBPTiBXT1JLIFRIQVQgSEFTIEJFRU4gU1BPTlNPUkVEIE9SIFNVUFBPUlRFRApCWSBBTiBBR0VOQ1kgT1IgT1JHQU5JWkFUSU9OIE9USEVSIFRIQU4gRFNVLCBZT1UgUkVQUkVTRU5UIFRIQVQgWU9VIEhBVkUKRlVMRklMTEVEIEFOWSBSSUdIVCBPRiBSRVZJRVcgT1IgT1RIRVIgT0JMSUdBVElPTlMgUkVRVUlSRUQgQlkgU1VDSApDT05UUkFDVCBPUiBBR1JFRU1FTlQuCgpEU1Ugd2lsbCBjbGVhcmx5IGlkZW50aWZ5IHlvdXIgbmFtZShzKSBhcyB0aGUgYXV0aG9yKHMpIG9yIG93bmVyKHMpIG9mIHRoZQpzdWJtaXNzaW9uLCBhbmQgd2lsbCBub3QgbWFrZSBhbnkgYWx0ZXJhdGlvbiwgb3RoZXIgdGhhbiBhcyBhbGxvd2VkIGJ5IHRoaXMKbGljZW5zZSwgdG8geW91ciBzdWJtaXNzaW9uLgo=

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